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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2011.11
- 수록면
- 66 - 69 (4page)
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This paper presents a 20-bit sigma-delta ADC for smart power metering system. This design adopts a fourth-order low-pass sigma-delta modulator and a decimation filter. In this design, a design approach has been taken to achieve the wide dynamic range of the modulator through the system-level modeling and co-simulation. In the design of high-resolution switched-capacitor sigma-delta modulators, design parameters are optimized, including the performance of the building blocks, in order to achieve the desired signal-to-noise ratio. The sigma-delta ADC consumes 5.81 mW from a 1.8 V supply. Manufactured in 0.18 um 1-poly, 6-metal CMOS process, the area of the sigma-delta ADC is 3.07 x 0.6 mm2. The ADC achieves 105.92 dB dynamic range with 256 oversampling ratio.
목차
Abstract
Ⅰ. Introduction
Ⅱ. Architecture
Ⅲ. Building Blocks
Ⅳ. Experimental Results
Ⅴ. Conclusion
Reference
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