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임정택 (충남대학교) 최한웅 (충남대학교) 이은규 (알에프피아) 최선규 (알에프피아) 송재혁 (충남대학교) 김상효 (충남대학교) 이동주 (LIG넥스원) 김완식 (LIG넥스원) 김소수 (국방과학연구소) 서미희 (국방과학연구소) 정방철 (충남대학교) 김철영 (충남대학교)
저널정보
한국전자파학회 한국전자파학회논문지 韓國電磁波學會論文誌 第29卷 第11號(通卷 第258號)
발행연도
2018.11
수록면
834 - 841 (8page)

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본 논문은 0.18 μm CMOS 공정을 이용한 Sub-GHz 근거리 무선통신을 위한 전력증폭기 설계에 관한 내용이다. 가상 접지 노드를 용이하게 형성하며, 출력전력을 키울 수 있는 차동구조로 설계하였으며, breakdown으로 인한 문제를 최소화하기 위하여 cascode 구조로 설계하였다. 또한 출력전력과 Power Added Efficiency(PAE)가 최대가 되도록 트랜지스터 게이트 폭을 결정하고, matching network으로 인한 손실이 최소화하기 위해 EM simulation을 통하여 balun을 최적화하였다. 제작된 전력증폭기는 크기가 2.14 ㎟이며, 860~960 MHz의 주파수 범위에서 49.5 dB 이상의 이득과 26.7 dBm의 최대출력을 가지며, 최대효율은 20.7 %이다.

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. Sub-GHz 전력증폭기 설계
Ⅲ. Sub-GHz 전력증폭기 특성 시험
Ⅳ. 결론
References

참고문헌 (6)

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