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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2021.9
- 수록면
- 762 - 771 (10page)
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이 논문은 SAR (successive approximation register) ADC (analog to digital converter)의 구성요소인 CDAC (capacitive digital to analog converter)의 기준 전압 세분화를 통해 에너지 소모 감소와 적은 면적에 장점이 있는 커패시터 스위칭 구조를 제안한다. 10-bit SAR-ADC의 경우, 제시된 구조에서 기준 전압 비트를 3-bit로, 커패시터 배열 비트를 6-bit로 사용할 경우, 에너지가 99.97 % 절약되고, 면적(커패시터 수)은 93.75 % 절약된다. 또한, 에너지 소비를 최소로 하는 스위칭 알고리즘을 제안하고, 수식으로 증명하였다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 본문
Ⅲ. 시뮬레이션
Ⅳ. 결론
References
참고문헌 (6)
참고문헌 신청
B. P. Ginsburg / 2005 / An energyefficient charge recycling approach for a SAR converter with capacitive DAC / IEEE International Symposium on Circuits and Systems 1:184~187
C. Liu / 2010 / A 10-bit 50-MS/s SAR ADC with a monotonic capacitor switching precedure / Proceedings of the IEEE Journal of Solid-State Circuits 45(4):731~740
H. Zhang / 2017 / Energy-efficient higher-side-reset-and-set switching scheme for SAR ADC / Electronics Letters 53(18):1238~1240
J. Zhao / 2018 / VAQ-based tri-level switching scheme for SAR ADC / Electronics Letters 54(2):66~68
L. Xie / 2014 / Energy-efficient hybrid capacitor switching scheme for SAR ADC / Electronics Letters 50(1):22~23
C. Liu / 2010 / A 10-bit 50-MS/s SAR ADC with a monotonic capacitor switching precedure / Proceedings of the IEEE Journal of Solid-State Circuits 45(4):731~740
H. Zhang / 2017 / Energy-efficient higher-side-reset-and-set switching scheme for SAR ADC / Electronics Letters 53(18):1238~1240
J. Zhao / 2018 / VAQ-based tri-level switching scheme for SAR ADC / Electronics Letters 54(2):66~68
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