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본 논문에서는 디지털 패스가 없는 연산증폭기 공유 기법을 이용한 145㎼, 87dB SNR을 갖는 저전력 3차 Sigma-Delta 변조기를 제안한다. 기존 구조는 아날로그와 디지털 패스를 사용한 구조로 첫 번째 적분기의 계수가 작다는 단점을 지연된 피드포워드 패스를 추가하여 개선하였다. 제안한 구조는 디지털 패스를 제거하여 첫 번째 적분기의 계수를 크게 하였고 연상증폭기 공유 기법을 이용하여 전력소모가 기준 구조보다 적다. 전원전압 1.8V, 신호대역폭 20KHz, 샘플링 주파수 2.8224MHz 조건에서 0.18㎛ CMOS 공정을 이용하여 제안한 구조의 시뮬레이션한 결과, SNR(Signal to Noise Ratio)은 87dB, 전력소비는 145㎼이다.
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1. [학술지(정기간행물)] - Aldo Pena-Perez / 2012 / A 88-dB DR, 84-dB SNDR Very Low-Power Single Op-Amp Third-Order Modulator / IEEE J. Solid-State Circuits 47 (9) : 2017 ~ 2118
2. [학술대회논문] - Huy-Binh Le / 2010 / A Regulator-Free 84dB DR Audio-Band ADC for Compact Digital Microphones / IEEE Asian Solid-State Circuits Conference : 1 ~ 4
3. [단행본] - Richard Schreier / 2005 / Understanding Delta-Sigma Data Converters / Wiley-IEEE Press : 1 ~ 10
4. [학술지(정기간행물)] - Chuc K. Thanh / 1997 / A Second-Order Double-Sampled Delta-Sigma Modulator Using Individual-Level Averaging / IEEE J. Solid-State Circuits 32 (8) : 1269 ~ 1273
5. [학술대회논문] - Daisuke Kanemoto / 2011 / A 7. 5mW 101dB SNR Low-Power High-Performance Audio Delta-Sigma Modulator Utilizing Opamp Sharing Technique / SoC Design Conference(ISOCC), 2011 International : 66 ~ 69
2. [학술대회논문] - Huy-Binh Le / 2010 / A Regulator-Free 84dB DR Audio-Band ADC for Compact Digital Microphones / IEEE Asian Solid-State Circuits Conference : 1 ~ 4
3. [단행본] - Richard Schreier / 2005 / Understanding Delta-Sigma Data Converters / Wiley-IEEE Press : 1 ~ 10
4. [학술지(정기간행물)] - Chuc K. Thanh / 1997 / A Second-Order Double-Sampled Delta-Sigma Modulator Using Individual-Level Averaging / IEEE J. Solid-State Circuits 32 (8) : 1269 ~ 1273
5. [학술대회논문] - Daisuke Kanemoto / 2011 / A 7. 5mW 101dB SNR Low-Power High-Performance Audio Delta-Sigma Modulator Utilizing Opamp Sharing Technique / SoC Design Conference(ISOCC), 2011 International : 66 ~ 69
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