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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2019.1
- 수록면
- 1,145 - 1,152 (8page)
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본 논문에서는 디지털 회로와 저소비전력 및 고속연산의 장점을 가진 아날로그 회로를 혼용하기 위하여, 저전력 전류모드 12비트 ADC (Analog to Digital Converter)를 제안하였다. 제안하는 12비트 ADC는 4비트 ADC의 cascade 구조를 사용하여 소비전력을 줄일 수 있었으며, 변환 current mirror 회로를 사용해 칩면적을 줄일 수 있었다. 제안된 ADC는 매그나칩/SK하이닉스 350nm 공정으로 구현하였고, Cadence MMSIM을 사용하여 post-layout simulation를 진행하였다. 전원전압 3.3V에서 동작하고, 면적은 318um x 514um를 차지하였다. 또한 제안하는 ADC는 소비전력 3.4mW의 낮은 소비전력으로 동작하는 가능성을 나타내었다.
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참고문헌 (10)
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P. Dudek / 2000 / A CMOS General-Purpose Sampled-Data Analog Processing Element / IEEE Trans. on circuits and systems 47(5):467
여성대 / 2016 / Voltage Scaling 기반의 저전력 전류메모리 회로 설계 / 한국전자통신학회 논문지 11(2):159~164
A. Ali / 2014 / A 14Bit 1GS/s RF Sampling Pipelined ADC With Background Calibration / IEEE J. of Solid-State Circuits 49(12):2857~2865
D. Patidar / 2017 / Design And Simulation Of 10-Bit Pipeline Adc Using Switch Capacitor Circuit And Opamp Sharing In 0.25 CMOS Technology at 2.5V / Int. J. of Engineering Trends and Technology(IJETT) 43(3):151~156
채용웅 / 2018 / 영전압스위칭의 위상천이방식 / 한국전자통신학회 논문지 13(6):1177~1182
여성대 / 2016 / Voltage Scaling 기반의 저전력 전류메모리 회로 설계 / 한국전자통신학회 논문지 11(2):159~164
A. Ali / 2014 / A 14Bit 1GS/s RF Sampling Pipelined ADC With Background Calibration / IEEE J. of Solid-State Circuits 49(12):2857~2865
D. Patidar / 2017 / Design And Simulation Of 10-Bit Pipeline Adc Using Switch Capacitor Circuit And Opamp Sharing In 0.25 CMOS Technology at 2.5V / Int. J. of Engineering Trends and Technology(IJETT) 43(3):151~156
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