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한국전자통신학회 한국전자통신학회 논문지 한국전자통신학회 논문지 제15권 제3호
발행연도
2020.1
수록면
479 - 486 (8page)

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이 논문에서는 아날로그 전류모드 인공지능 프로세서에서 핵심 디바이스 중에 하나인 아날로그 전류 모드 곱셈기 회로의 선형성과 동적범위 향상을 위한 설계 기법을 소개한다. 제안하는 회로는 4 quadrant Translinear loop를 NMOS 트랜지스터만으로 구성하여, 트랜지스터의 물리적 Mismatch를 최소화하는 설계로 0.35 CMOS 공정에서 117 x 109로 구현가능하였으며, 최대 전고조파왜율 0.3% 의 선형성을 확보할 수 있었다. 제안한 아날로그 전류모드 곱셈기는 전류모드 인공지능 프로세서의 핵심 회로로 유용할 것으로 기대된다.
#CMOS analog multiplier #four quadrant #squarer circuit #current-mode #translinear loop

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W. Alaloul / 2018 / An Artificial Neural Networks(ANN)Model for Evaluating Construction Project Performance Based on Coordination Factors / Cogent Engineering 5(1) google schola C. Enz / 1996 / Emerging Technologies: Designing Low Power Digital Systems :79~133 google schola H. Elwan / 1997 / Low-Voltage Low-Power CMOS Current Conveyors / Circuits and Systems I: Fundamental Theory and Applications, IEEE Transactions on 44:828~835 google schola 여성대 / 2016 / Voltage Scaling 기반의 저전력 전류메모리 회로 설계 / 한국전자통신학회 논문지 11(2):159~164 google schola 박소연 / 2019 / 4비트 ADC 반복구조를 이용한 저전력 전류모드 12비트 ADC / 한국전자통신학회 논문지 14(6):1145~1152 dbpia

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